DDR3-2000 pour OCZ

Publié le 19 mars 2008 , par Tanguy Andrillon - mis à jour le 05 juillet 2009 à 19h - dans Hardware

Suite à la sortie du nForce 790i SLI supportant la DDR3, les constructeurs présentent leur kit Dual Channel de DDR3 ".SLI Ready". C'est OCZ qui ouvre le bal avec son kit Dual Channel OCZ PC3-16000 NVIDIA SLI-Ready Edition de 2 x 1 Go. Compatibles avec l'EPP 2.

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Réactions


Patatrace - le 19/03/08 à 10:44
J'ai remarqué aussi que la ddr3 baissait pas mal ces temps ci. Mais j'ai un peu de mal à saisir l'intérêt d'acheter du kit haute fréquence, sachant qu'il suffit de prendre un processeur Intel de base à haut coefficient multiplicateur pour ne pas être bridé dans son overclocking
Phenix.ent - le 19/03/08 à 10:45
Ça reste vraiment très cher pour le peu de performance que l'on gagne (2x1Go DDR2 coute 5 fois moins cher). Mais bon, c'est comme toute les nouvelles mémoire, faut attendre pour que les performances soient la et que le prix soit raisonnables :crazy:
apaige - le 19/03/08 à 13:41
Une fois de plus, la RAM ne tourne pas à 2000 MHz, mais à 1000 MHz, et effectue deux transferts par révolution, soit 2000 MT/s. Il serait temps de cesser de propager une conception erronée du fonctionnement de la RAM (c'est déjà suffisamment compliqué comme ça entre la fréquence des modules, la fréquence du bus, le nombre de transferts par seconde, le nom du standard, le nom commercial et la vitesse de transfert en gigaoctets par seconde). http://en.wikipedia.org/wiki/DDR3_SDRAM
cycnus - le 19/03/08 à 13:48
Pourquoi acheter de la DDR3 bas de gamme en 1066 alors que de la DDR2 à 1066 haut de gamme avec des timings plus serrés coûte 2 fois moins cher ?
Foudge - le 19/03/08 à 14:55
Moi ce qui fait rire c'est tous ceux qui ont craché sur la DDR2 à cause de leur timing "pourris" et qui disaient préférer attendre la DDR3 : 9-9-9-28 lol J'espère que depuis ils ont compris que c'était exprimé en cycles, et que plus la fréquence monte plus les cycles sont court et plus les débits augmentent.
cycnus - le 19/03/08 à 20:25
FoudgeMoi ce qui fait rire c'est tous ceux qui ont craché sur la DDR2 à cause de leur timing "pourris" et qui disaient préférer attendre la DDR3 : 9-9-9-28 lol J'espère que depuis ils ont compris que c'était exprimé en cycles, et que plus la fréquence monte plus les cycles sont court et plus les débits augmentent.
Certes mais ça veut dire aussi que le temps d'accès s'améliore (quand il s'améliore) moins vite que le débit. Pas dramatique dans la mesure où le débit semble davantage déterminer les performances globales mais au prix où l'on paye ces nouvelles barrettes, je comprends que certains soient exigeants !
SartMatt - le 20/03/08 à 00:17
cycnus > Le problème, c'est que le temps d'accès ne peut pas vraiment beaucoup s'améliorer. Ce qui limite le temps d'accès, c'est la fréquence interne des puces mémoire, elles répondront jamais en moins d'un de leurs cycles. Or, si en SDRAM simple, les puces fonctionnaient strictement à la même fréquence que l'horloge externe du bus, elles sont aujourd'hui au huitième de cette fréquence (1/2 en DDR, 1/4 en DDR2, 1/8 en DDR3). Donc quand la puce répond en un cycle de son horloge (le minimum qu'elle peut faire), ça fait 8 cycles de l'horloge du bus en DDR3. On ne pourra donc pas descendre à des timings inférieurs à 8, à moins de mettre en place des mécanismes de prédiction et de cache au sein même de la barrette. L'autre solution serait de pousser la fréquence réelle des puces, qui est comprise entre 100 et 300 MHz depuis des années, mais je pense qu'il doit y avoir de bonnes raisons à cette non augmentation des fréquences.
Anne Aunimousse - le 20/03/08 à 10:22
En fait en DDR2 le bus interne est plus large que le bus externe (4n prefetch) ce qui fait qu'une ram ddr-2 peut répondre en moins d'un cycle d'horloge interne par mot, les buffers i/o tournant au double de la fréquence interne, idem pour la DDR3 (mais tout en x2 donc). De plus les timings sont toujours exprimés par rapport à la fréquence d'horloge i/o et non à la fréquence effective que ce soit en ddr2 ou ddr3 la fréquence i/o est la moitié de l'effective donc les timings minimums seraient de 2 en DDR2 (on trouve des barettes en CL3) et 4 en DDR3 (on trouve des barettes en CL5 déjà...) et non pas 8 comme tu l'indiques. Après évidemment si on monte en fréquence les cycles deviennent trop courts en temps et ça tient plus...
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